module slave_ram #(
    parameter int unsigned AXI_ID_WIDTH      = 7,
    parameter int unsigned AXI_ADDR_WIDTH    = 48,
    parameter int unsigned AXI_DATA_WIDTH    = 128,
    parameter int unsigned AXI_USER_WIDTH    = 2
)(
    input   logic                        clk,
    input   logic                        reset,

    input   logic                        req_i,
    input   logic                        we_i,
    input   logic [AXI_ADDR_WIDTH-1:0]   addr_i,
    input   logic [AXI_DATA_WIDTH/8-1:0] be_i,
    input   logic [AXI_DATA_WIDTH-1:0]   data_i,
    output  logic [AXI_DATA_WIDTH-1:0]   data_o
);


/// --------------------------- RAM --------------------------- ///
localparam int RamSize = 32'h400_0000 / 16;//6145;
logic [RamSize-1:0][127:0] ram_mem = {
       128'h00000000_00000000_00000000_00000000,
       128'h00000000_00000000_00000000_00000000,
       128'h00000000_00000000_00000000_00000000,
       128'h00000000_00000000_00000000_00000000,
       128'h00000000_00000000_00000000_00000000,
       128'h00000000_00000000_00000000_00000000,
       128'h00000000_00000000_00000000_00000000,
       128'h00000000_00000000_00000000_00000000,
       128'h00000000_00000000_00000000_00000000,
       128'h00000000_00000000_00000000_00000000,
       128'h00000000_00000000_00000000_00000000,
       128'h00000000_00000000_00000000_00000000,
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       128'h01050c21_0114a983_01010c21_01071021,
       128'h01011484_2b8041e3_01070c84_01011c63,
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       128'h0280080d_2940006c_0381898c_1400006c,
       128'h53fdfbff_02c00529_293f818d_0281600d,
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       128'h53fe1bff_02c00529_293f818d_0281e00d,
       128'h00108d8c_02c0812c_53ffebff_0280080d,
       128'h2940006c_0381618c_1400006c_53fef7ff,
       128'h43fd7c3f_0280080d_2940006c_0381e18c,
       128'h1400006c_44001d80_0340828c_53fe8fff,
       128'h293f81ac_02c00529_0280800c_00108d8d,
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       128'h47fda71f_02808009_53ff23ff_43fdb99f,
       128'h02fffd2c_53ff07ff_02bffd4a_53feb7ff,
       128'h02c00529_293f818d_0281880d_00108d8c,
       128'h02c0812c_5bfef52c_0280800c_53feffff,
       128'h02808009_5c00b12c_0280800c_4400d180,
       128'h0340828c_53ff17ff_5ffef1cc_02808009,
       128'h0280080c_580025cc_0280400c_5801614c,
       128'h580165ac_0280800c_44003ae0_40003f00,
       128'h5ffea12c_0280800c_6ffe292d_4c000020,
       128'h02c10063_28c0a078_28c0c077_28c0e061,
       128'h57fc4fff_0015028b_293f818d_0280b40d,
       128'h02c005a9_00108d8c_02c081ac_53ffd3ff,
       128'h5fff4969_440086e0_43ff8b1f_6c00c92a,
       128'h4000ce20_53ff7fff_02c00589_5801b9cd,
       128'h0280080d_5801a5cd_0280400d_02807c0c,
       128'h5fff7949_58000969_44020ae0_43ffbf1f,
       128'h02808009_68003d2a_5fff292c_0280800c,
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       128'h00df014c_58017569_00df016b_53ff2fff,
       128'h5ffff12d_293ffd8f_0010a50c_02c00529,
       128'h58019d30_5002a400_5c000d2c_02808010,
       128'h0280c00f_0280800c_6fff592d_00df014d,
       128'h43ff623f_6bfff12d_293ffd8f_0010a50c,
       128'h02c00529_58010530_50000800_02808010,
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       128'h6fff912d_4400d140_00df016d_00150068,
       128'h02900017_00150009_47ffd31f_00150194,
       128'h00150068_03400a98_5000d800_293f818d,
       128'h0280ac0d_02c005a9_00108d8c_02c081ac,
       128'h40024580_0340128c_44018020_0280040d,
       128'h2900006c_0280c00c_5802edcc_0280080c,
       128'h580289cc_0280400c_4400d120_4400e6e0,
       128'h40011b00_40006d80_03400a8c_6fffcdae,
       128'h293ffdec_0010a50f_002339b0_02c00529,
       128'h00005e0c_68000a4f_00005d8c_0010322c,
       128'h0280c190_006781ec_0023b9af_0015020d,
       128'h58003933_50000c00_02808013_02bfda31,
       128'h02802412_00150068_00150009_00153231,
       128'h0013b1ec_00133231_0281840f_02810411,
       128'h0340828c_00150194_00150018_4400cae0,
       128'h0040818c_0014b28c_02bfbc0c_44001d00,
       128'h03404298_03500297_00150121_2400406a,
       128'h0015010d_0015014e_29c0a078_29c0c077,
       128'h29c0e061_24004874_02ff0063_53ffafff,
       128'h001500d8_47ff5d3f_001500d6_53ff8bff,
       128'h47ff693f_001500d8_001500d6_4c000020,
       128'h02c18063_28c10078_00150304_28c0207f,
       128'h28c0407e_28c0607d_28c0807c_28c0a07b,
       128'h28c0c07a_28c0e079_28c12077_28c14076,
       128'h28c16061_6bffe79e_4c000321_02c00718,
       128'h02c0079c_02808004_00150345_00150367,
       128'h00150306_6c00279e_00df03de_0011f31c,
       128'h400033e0_03400bff_47ffe6ff_4c000321,
       128'h001502d8_00150345_00150367_38005fa4,
       128'h02fffef7_0011dec6_0010ded6_40005ee0,
       128'h5fffeb16_4c000321_02808004_00150345,
       128'h02c00718_00150367_00150306_001500d8,
       128'h00109ad6_0011a6d6_6c00d136_00df0156,
       128'h4400c980_0015015e_00150137_0015011d,
       128'h001500fb_001500dc_001500ba_00150099,
       128'h0015017f_03400d6c_29c10078_29c14076,
       128'h29c16061_29c0207f_29c0407e_29c0607d,
       128'h29c0807c_29c0a07b_29c0c07a_29c0e079,
       128'h29c12077_02fe8063_4c000020_4c000020,
       128'h381018a4_6c0008c7_4c000020_63fff585,
       128'h00408084_001030cc_00041184_0015000c,
       128'h64001805_4c000020_02c04063_00150004,
       128'h28c02061_5417ec00_02fdc084_1a000044,
       128'h5417f800_02fd8084_1a000044_54188400,
       128'h02fd4084_0396aca5_1a000044_1400c885,
       128'h54181800_02fcc084_1a000044_5418a400,
       128'h02fc8084_1a000044_00150085_54005c00,
       128'h00150004_028fa005_02800806_54184400,
       128'h02fc0084_1a000044_54185000_29c02061,
       128'h02fbc084_02ffc063_1a000044_54000000,
       128'h4c0000a0_38728000_38720000_29c000a4,
       128'h14a80004_180bf8c5_4c000181_0300018c,
       128'h1600000c_0384118c_1438000c_38183585,
       128'h0300018c_1600000c_0380018c_1438006c,
       128'h0380100d_03840005_0400002c_0380400c,
       128'h0406042b_0320016b_03803c0b_0406002b,
       128'h0380440b_0015001f_0015001e_0015001d,
       128'h0015001c_0015001b_0015001a_00150019,
       128'h00150018_00150017_00150016_00150015,
       128'h00150014_00150013_00150012_00150011,
       128'h00150010_0015000f_0015000e_0015000d,
       128'h0015000c_0015000b_0015000a_00150009,
       128'h00150008_00150007_00150006_00150005,
       128'h00150004_03000063_16000003_03800063,
       128'h143800c3_00150002_00150001_4c000180,
       128'h0300018c_1600000c_0380518c_1438000c
};

/// read 
logic ram_cs;
// assign ram_cs = addr_i >= 64'h0000_0000 && addr_i < 64'h1FF0_0000;
assign ram_cs = addr_i[23:0] >= 24'h000000 && addr_i[23:0] < 24'hFFFFFF;
logic [AXI_ADDR_WIDTH-1:0] ram_raddr_q;
logic [AXI_DATA_WIDTH-1:0] ram_rdata_o;
always_ff @(posedge clk) begin
    if (ram_cs && req_i && ~ we_i) begin
        ram_raddr_q <= addr_i;
    end
end


logic [AXI_ADDR_WIDTH-1:0] ram_raddr; 

assign ram_raddr = ram_raddr_q[$clog2(RamSize)+3:4];
assign ram_rdata_o = reset ? '0 : ram_mem[ram_raddr];


/// write
logic [AXI_DATA_WIDTH-1:0] ram_rdata_i;

always_comb begin
    ram_rdata_i = ram_mem[addr_i[$clog2(RamSize)+3:4]];
    for (int i = 0; i < $bits(be_i); i++) begin
        if (be_i[i]) begin
            ram_rdata_i[i*8+:8] = data_i[i*8+:8];
        end
    end
end

always @(posedge clk) begin 
    if (ram_cs && req_i && we_i) begin
        ram_mem[addr_i[$clog2(RamSize)+3:4]] <= ram_rdata_i;
    end
end


/// --------------------------- UART --------------------------- ///

localparam int UARTSize = 1000;
logic [UARTSize-1:0][127:0] uart_map_mem = {
       128'h00000000_00000000_00000000_00000000,
       128'h00000000_00000000_00000000_00000000,
       128'h00000000_00000000_00000000_00000000,
       128'h00000000_00000000_00000000_00000000,
       128'h00000000_00000000_00000000_00000000,
       128'h00000000_00000000_00000000_00000000
};

/// read 
logic UART_cs;
assign UART_cs = addr_i >= 64'h1FF1_0000 && addr_i < 64'h1FF1_FFFF;
logic [AXI_ADDR_WIDTH-1:0] UART_raddr_q;
logic [AXI_DATA_WIDTH-1:0] UART_rdata_o;
always_ff @(posedge clk) begin
    if (UART_cs && req_i && ~ we_i) begin
        UART_raddr_q <= addr_i;
    end
end
assign UART_rdata_o = (UART_raddr_q[AXI_ADDR_WIDTH-1:4] == 36'h1FF1_001) ? 128'h20_00000000 :
                      uart_map_mem[UART_raddr_q[$clog2(UARTSize)+3:4]];


/// write registers
logic [AXI_DATA_WIDTH-1:0] uart_rdata_i;

always_comb begin
    uart_rdata_i = uart_map_mem[addr_i[$clog2(RamSize)+3:4]];
    for (int i = 0; i < $bits(be_i); i++) begin
        if (be_i[i]) begin
            uart_rdata_i[i*8+:8] = data_i[i*8+:8];
        end
    end
end

always @(posedge clk) begin 
    if (UART_cs && req_i && we_i) begin
        uart_map_mem[addr_i[$clog2(RamSize)+3:4]] <= uart_rdata_i;
    end
end

/// write, print
always @(posedge clk) begin
     if (UART_cs && req_i && we_i) 
     begin
        if(be_i[15:0] == 16'h01) /// write 8-bit
           begin
              $write("%c", data_i[7:0]);
           end
        else if(be_i[15:0] == 16'hf) /// write 32-bit
           begin
              $write("%c", data_i[7:0]);
           end
        else if(be_i[15:0] == 16'hff) /// write 64-bit
           begin
              $write("%c", data_i[7:0]);
           end   
        else if(be_i[15:0] == 16'hf0)
           begin
              $write("%c", data_i[39:32]);
           end
        else if(be_i[15:0] == 16'hf00)
           begin
              $write("%c", data_i[71:64]);
           end
        else if(be_i[15:0] == 16'hf000)
           begin
              $write("%c", data_i[103:96]);
           end
    end
end

/// Read Data Output
always @(*) begin 
    if (ram_cs) begin
        data_o = ram_rdata_o;
    end
    else if (UART_cs) begin
        data_o = UART_rdata_o;
    end
    else begin
        data_o = '0;
    end
end

endmodule
